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VHDL을 이용한 FPGA 디지털 설계: 실습부터 응용까지

CD1장포함 | IT Cookbook 한빛교재 시리즈 305
노승환 지음 | 한빛미디어 | 2009년 04월 27일 출간 이 책의 개정정보 : 2014년 출간
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상품상세정보
ISBN 9788979146707(8979146701)
쪽수 464쪽
크기 188 * 257 mm 판형알림

책소개

이 책이 속한 분야

[표지글]

이 책은 전기, 전자, 정보통신, 컴퓨터 관련학과 학생을 대상으로 한다. 기본원리→기초실습→응용실습의 단계적 학습으로 디지털 시스템 설계를 배우고, 학생들 스스로 디지털 시스템 설계를 할 수 있도록 만들었다. ALTERA의 Quartus Ⅱ를 설계 소프트웨어로 사용하며, 저자가 심혈을 기울여 제작한 DigComV32 실습키트로 실습할 수 있을 뿐만 아니라 시뮬레이션만으로도 설계한 결과를 확린할 수 있도록 했다.

이 책의 총서

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저자소개

저자가 속한 분야

저자 노승환
현재 공주대학교 정보통신공학부 교수로 재직 중이다. 컴퓨터 및 네트워크 관련 주제로 1993년 고려대학교 박사학위를 취득하고, 1994년부터 현재까지 공주대학교에서 강의를 하고 있다. 이동통신망에서 핸드오버에 관해 연구하고 있으며, 최근에는 휴대 인터넷 및 Mobile IP 기반의 핸드오버 프로토콜에 관한 연구를 진행 중이다. 또한 국내에 임베디드 시스템이 소개되기 시작한 시절부터 임베디드 프로세서, 리눅스 등을 이용한 하드웨어와 응용 소프트웨어를 개발하였으며, 이를 이용하여 웨어러블 컴퓨터(wearable computer)에 관한 연구를 수행하였다.

목차

PART1 ALTERA Quartus Ⅱ 설치와 사용

Chapter 01. Quartus Ⅱ 설치
들어가기에 앞서
01_ Quartus Ⅱ Web Edition(v8.0 SP1) 소프트웨어 다운로드
02_ 라이선스 설치

Chapter 02. Quartus Ⅱ의 사용
들어가기에 앞서
01_ 프로젝트 생성
02_ VHDL 컴파일
03_ 시뮬레이션
04_ 디바이스와 핀 할당
05_ FPGA에 다운로드하기
06_ 계층적 프로젝트

PART2 디지털 논리회로의 설계 및 실습

Chapter 03. 조합논리회로의 설계
들어가기에 앞서
01_ 기본 게이트(AND, OR, NOT)의 설계
Lab_01 Quartus II 소프트웨어를 이용한 디지털 논리회로 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
02_ 전가산기
Lab_02 전감산기의 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
03_ 디코더
Lab_03 인코더 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
04_입출력 장치 실습(스위치 인코딩)
Lab_04 7-세그먼트 디코더 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
05 멀티플렉서
Lab_05 디멀티플렉서 설계
VHDL 설계 실습 결과보고서
연습문제
06_ 크기 비교기
Lab_06 수의 정렬 회로 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
07_ n비트 가산/감산기
Lab_07 BCD 가산기의 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
08_ ‘1’ 개수 카운터
Lab_08 Count leading ones
:: VHDL 설계 실습 결과보고서
:: 연습문제
09_ 패리티 발생기 설계
Lab_09 패리티 검사기 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
10_ 리플 가산기 설계
Lab_10 Carry look ahead 가산기 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제

Chapter 04. 순차논리회로의 설계
들어가기에 앞서
01_ 간단한 상태도의 구현
Lab_11 클럭의 분주
:: VHDL 설계 실습 결과보고서
:: 연습문제
02_ 레지스터의 표현
Lab_12 병렬-직렬 변환회로
:: VHDL 설계 실습 결과보고서
:: 연습문제
03_ Up-down 카운터
Lab_13 동기식 BCD 카운터 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제
04_ 순차검출기
Lab_14 교통신호등 제어기 설계
:: VHDL 설계 실습 결과보고서
:: 연습문제

Chapter 05. 기타 논리회로의 설계
들어가기에 앞서
01_ 동기식 출력회로
02_ 스텝 클럭(펄스) 발생회로
03_ 양방향 버스

Chapter 06. 디지털 시계 설계
들어가기에 앞서
01_ MSL의 설계
02_ DCL의 설계
03_ BSF의 생성과 BDF/Schematic 설계
04_ TL의 설계
05_ AL의 설계
06_ 7-세그먼트 드라이버 설계
07_ 부가적인 기능의 추가
08_ 디지털 시계의 실행

PART3 기본 컴퓨터의 설계

Chapter 07. 기본 컴퓨터의 실행
들어가기에 앞서
01_ 어셈블리 언어 프로그래밍과 실행
02_ 프로그램의 실행
03_ 예제 어셈블리 언어 프로그램

Chapter 08. 컴퓨터 구조 실습
들어가기에 앞서
01_ 레지스터 전달 표현 VHDL 설계
:: 컴퓨터 구조 실습 결과보고서
02_ ALSU의 VHDL 설계
:: 컴퓨터 구조 실습 결과보고서
03_ 마이크로 연산과 제어 함수
:: 컴퓨터 구조 실습 결과보고서
04_ 마이크로 연산의 이해
:: 컴퓨터 구조 실습 결과보고서
05_ 어셈블리 언어 프로그래밍
:: 컴퓨터 구조 실습 결과보고서
06_ 새로운 명령어의 추가
:: 컴퓨터 구조 실습 결과보고서

Chapter 09. 기본 컴퓨터의 설계
들어가기에 앞서
01_ 리셋 회로
02_ 시퀀스 카운터(SC)부
03_ 제어부
04_ 명령어 디코더부
05_ 산술연산부
06_ 레지스터부
07_ 입출력부
08_ 메모리
09_ 레지스터 출력

부록
부록 01_ VHDL Data Types, Operators and Attributes
부록 02_ DigComV32
부록 03_예제 프로그램 명령어 단위 실행 결과
부록 04_ 어셈블러 프로그래밍

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출판사 서평

◈마케팅 포인트

- 가장 일반적인 논리회로를 예제로 구성하였다.
- 실습키트를 이용해서 예제를 실행시킬 수 있으며, 실습키트가 없어도 시뮬레이션으로 동작을 확인할 수 있도록 구성하였다.

→ 실습키트(DigComV32)의 주요 특징
① ALTERA Quartus II를 이용하여 schematic 또는 VHDL로 설계한 디지털 논리회로를 실행할 수 있음
② 푸시버튼 스위치, 슬라이드 스위치, LED 및 7-세그먼트 등 다양한 입출력 장치를 내장하였으며, 구조가 간단하여 디지털 논리회로 실습에 적합
③ M. Morris... 더보기

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